ON4CRD ATU-V2 — ON4CRD-ATU-PULSE1-R1
PROTOTYPE ORIGINAL NON CONSTRUIT / NON QUALIFIE

Une carte60x45mm commande UNE bobine bistable deux fils dans les deux sens.
Elle complète les intentions de commande27relais des variantes20/50/150W.
Ce n'est ni un circuit RF, ni un pilote universel des axes motorisés>=500W.

ALIMENTATION ET BROCHAGE
J1 (SIL4, dessus, numéros dans netlist/layout):1=3V3 externe,2=REQ_A,3=REQ_B,4=GND.
J2 terminal5,08mm:1=VIN positif SELV24..28V,2=GND. J3:1=OUT1,2=OUT2.
J3 flotte: ne relier aucune borne bobine àGND. Inverser les deux fils inverse SET/RESET.
F1 réarmable0,5A hold>=30V, sérieD1 1N5819; référence exacte F1 et corps des borniers à vérifier avant commande.
D1 réduit VM: régler l'alimentation pour obtenir26,5V àVM en impulsion, sans dépasser28V àl'entrée.
DRV8871 pins1GND,2IN2,3IN1,4ILIM,5VM,6OUT1,7PGND,8OUT2,9PowerPADGND.
R4=150k1%: courant de découpage théorique0,389..0,465A (constante TI59..69kV).
Bobine K41P334 candidate:26,5V/80Ω=0,331A; capacité d'actionnement réelle, polarité et courant transitoire à mesurer.
La limite de courant n'est pas une régulation garantie précise à0,331A. Le DRV interrompt aussi sur surintensité/surchauffe internes.

LIMITEUR MATERIEL INDEPENDANT DU LOGICIEL
U3 SN74LVC1G32DBVR: REQ_A OU REQ_B →TRIG U2 LTC6993IS6-1.
Attention: LTC6993-1 est NON redéclenchable; LTC6993-2 serait redéclenchable et ne convient pas ici.
U4/U5 SN74LVC1G08DBVR: chaque requête ET Q →entrée correspondante du pont.
U2S6:1TRIG,2GND,3SET,4DIV,5V+,6OUT. RSET118k0,1%,DIV100k/39,2k0,1%,code4,POL0,NDIV4096.
t=4096*118000/50000*1µs=9.66656ms; borne calculée avec erreur CI3% sur -40…85°C + R0,1% + dérive R25ppm/K sur65°C=9.98271ms.
Cette borne théorique inclut la dérive R indiquée; elle ne remplace pas la mesure du montage, des transitoires et des conditions réelles. Qualifier sur toute la plage requise.
Un GPIO maintenu haut cesse d'alimenter la bobine après Q. Les deux requêtes doivent être0 au repos et entre impulsions.
00=sorties HiZ/sommeil;10=OUT1haut/OUT2bas;01=inverse;11=frein deuxsortiesbasses.
Ne jamais changer de sens pendant une impulsion; maintenir la requête choisie>=10ms puis00>=10ms.
Attendre20ms après alimentation3V3 avant première requête. Pulldowns10k des requêtes et entrées DRV; Ioff des portes TI et pulldowns internes DRV.
Une absence d'alimentation logique donne entrées basses. Vérifier démarrage/extinction et panne réelle sur banc.
Le monostable ne limite PAS une suite de fronts: cadence/duty-cycle, alimentation globale et arrêt PA matériel doivent être qualifiés séparément.
Le relais reste bistable après00: aucun état de contact ne peut être déduit d'un GPIO ou du courant seul.

ENERGIE ET THERMIQUE
C1=220µF50V local; C2=100nF50V prèsVM. En HiZ, les diodes internes rendent l'énergie inductive versVM.
D2 SMBJ28A candidate:VRWM28V,VBR31,1..34,4V,clamp45,4V@13,2A.50V est la limite ABSOLUE du DRV,45V sa limite recommandée.
Le clamp catalogue45,4V ne garantit PAS VM<=45V: mesurer les pointes àla broche et qualifier TVS/retour/câbles selon Lréelle.
Pour une énergie0,5*L*I², Vfinal=sqrt(Vinitial²+L*I²/C), sans dissipation. Lbobine et ESR inconnues: aucun feu vert transitoire implicite.
Perte conduction à0,331A avecRDSonmax0,68Ω~0,075W pendantl'impulsion; température réelle,duty-cycle et plateau fermé non validés.
9vias0,3mm sousPowerPAD doivent être remplis et capés; ne pas commander ces vias ouverts sous pâte.
PlanGND cuivre dessous présent; le Gerber pâte a4fenêtres1,05x1,35mm (~61,5%de l'EPAD). Valider stencil et reflow avecassembleur.
Pistes0,25mm sur cettecarte pour0,331Aimpulsionnel; ne pas extrapoler au3,6A de la fiche CI.

INTEGRATION27CARTES
4modulesMCP23017 externes0x20..0x23 alimentés3V3 fournissent64GPIO.
Canal k0..26:GPIOglobal2k=REQ_A,2k+1=REQ_B;modulefloor(GPIOglobal/16),portA bits0..7 puisB bits0..7.
Pico2I2C0GP4=SDA/GP5=SCL; pullups selon modules, adresse strapsA2..A0=000/001/010/011.
Au reset MCP:entrées par défaut, pulldowns carte imposent0. Précharger OLAT=0 avantIODIR=sortie.
54requêtes actuation; acquittements/retours contact demandent interface séparée et validations RF/interverrouillage.
Connectique3V3/SELV détrompée, câblage bobines torsadé, traversées filtrées versbaieRF, pas de boucles avecblindage RF.
Les modules ne sont pas autorisés à commuter sous RF: inhibition PA+retour matériel+RF faible vérifiés avant touteimpulsion.

FABRICATION ET VERIFICATIONS A FAIRE
Gerber2couches réels+masques+pâte+sérigraphie+contour,ExcellonPTH/NPTH,netlist avecchaque piste etvia,BOM etgénérateur inclus.
Les traces etobstacles sont routés parA* reproductible et vérifiés géométriquement; contrôle DRC indépendant CAO/fabricant encore requis.
Inspecter vuesGerber, pin1/polarités, entraxes et corpsachetés avantprototype. Aucun marquage de certification ou validation RF.
BancSELV limité encourant:mesurerpolarité, durée requêtebloquée,11,00,démarrage, extinction, courantbobine,clampVM, répétitionettempérature.
PuiscontrôlercontactRF sanspuissance;feedbackréel,firmwareHALetqualificationsRFrestent des portesdelibération.

SOURCES PRIMAIRES
TI DRV8871 pinout, truth table, current limit and DDA0008B land pattern
https://www.ti.com/lit/ds/symlink/drv8871.pdf

ADI LTC6993-1 nonretriggerable rising-edge, DIVCODE4, TSOT23 S6 footprint
https://www.analog.com/media/en/technical-documentation/data-sheets/ltc6993-6993-1-6993-2-6993-3-6993-4.pdf

TI SN74LVC1G32 OR, DBV0005A land pattern
https://www.ti.com/lit/ds/symlink/sn74lvc1g32.pdf

TI SN74LVC1G08 AND, DBV0005A pinout and Ioff
https://www.ti.com/lit/ds/symlink/sn74lvc1g08.pdf

Vishay SMBJ28A transient suppressor:28Vstandoff,45.4Vclamp@13.2A
https://www.vishay.com/docs/88392/smbj.pdf

Microchip MCP23017, external GPIO expansion
https://ww1.microchip.com/downloads/en/devicedoc/20001952c.pdf


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